[llvm] [RISCV] Allow non-power-of-2 vectors for VLS code generation (PR #97010)
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Fri Jun 28 00:04:19 PDT 2024
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-def nxv1f16 : VTScalableVec<1, f16, 169>; // n x 1 x f16 vector value
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-def nxv1bf16 : VTScalableVec<1, bf16, 175>; // n x 1 x bf16 vector value
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-
-def nxv1f32 : VTScalableVec<1, f32, 181>; // n x 1 x f32 vector value
-def nxv2f32 : VTScalableVec<2, f32, 182>; // n x 2 x f32 vector value
-def nxv4f32 : VTScalableVec<4, f32, 183>; // n x 4 x f32 vector value
-def nxv8f32 : VTScalableVec<8, f32, 184>; // n x 8 x f32 vector value
-def nxv16f32 : VTScalableVec<16, f32, 185>; // n x 16 x f32 vector value
-
-def nxv1f64 : VTScalableVec<1, f64, 186>; // n x 1 x f64 vector value
-def nxv2f64 : VTScalableVec<2, f64, 187>; // n x 2 x f64 vector value
-def nxv4f64 : VTScalableVec<4, f64, 188>; // n x 4 x f64 vector value
-def nxv8f64 : VTScalableVec<8, f64, 189>; // n x 8 x f64 vector value
-
-def x86mmx : ValueType<64, 190>; // X86 MMX value
-def Glue : ValueType<0, 191>; // Pre-RA sched glue
-def isVoid : ValueType<0, 192>; // Produces no value
-def untyped : ValueType<8, 193> { // Produces an untyped value
+def v5i1 : VTVec<5, i1, 21>; // 5 x i1 vector value
+def v7i1 : VTVec<7, i1, 22>; // 7 x i1 vector value
+def v8i1 : VTVec<8, i1, 23>; // 8 x i1 vector value
+def v15i1 : VTVec<15, i1, 24>; // 15 x i1 vector value
+def v16i1 : VTVec<16, i1, 25>; // 16 x i1 vector value
+def v32i1 : VTVec<32, i1, 26>; // 32 x i1 vector value
+def v64i1 : VTVec<64, i1, 27>; // 64 x i1 vector value
+def v128i1 : VTVec<128, i1, 28>; // 128 x i1 vector value
+def v256i1 : VTVec<256, i1, 29>; // 256 x i1 vector value
+def v512i1 : VTVec<512, i1, 30>; // 512 x i1 vector value
+def v1024i1 : VTVec<1024, i1, 31>; // 1024 x i1 vector value
+def v2048i1 : VTVec<2048, i1, 32>; // 2048 x i1 vector value
+
+def v128i2 : VTVec<128, i2, 33>; // 128 x i2 vector value
+def v256i2 : VTVec<256, i2, 34>; // 256 x i2 vector value
+
+def v64i4 : VTVec<64, i4, 35>; // 64 x i4 vector value
+def v128i4 : VTVec<128, i4, 36>; // 128 x i4 vector value
+
+def v1i8 : VTVec<1, i8, 37>; // 1 x i8 vector value
+def v2i8 : VTVec<2, i8, 38>; // 2 x i8 vector value
+def v3i8 : VTVec<3, i8, 39>; // 3 x i8 vector value
+def v4i8 : VTVec<4, i8, 40>; // 4 x i8 vector value
+def v5i8 : VTVec<5, i8, 41>; // 5 x i8 vector value
+def v7i8 : VTVec<7, i8, 42>; // 7 x i8 vector value
+def v8i8 : VTVec<8, i8, 43>; // 8 x i8 vector value
+def v15i8 : VTVec<15, i8, 44>; // 15 x i8 vector value
+def v16i8 : VTVec<16, i8, 45>; // 16 x i8 vector value
+def v32i8 : VTVec<32, i8, 46>; // 32 x i8 vector value
+def v64i8 : VTVec<64, i8, 47>; // 64 x i8 vector value
+def v128i8 : VTVec<128, i8, 48>; // 128 x i8 vector value
+def v256i8 : VTVec<256, i8, 49>; // 256 x i8 vector value
+def v512i8 : VTVec<512, i8, 50>; // 512 x i8 vector value
+def v1024i8 : VTVec<1024, i8, 51>; // 1024 x i8 vector value
+
+def v1i16 : VTVec<1, i16, 52>; // 1 x i16 vector value
+def v2i16 : VTVec<2, i16, 53>; // 2 x i16 vector value
+def v3i16 : VTVec<3, i16, 54>; // 3 x i16 vector value
+def v4i16 : VTVec<4, i16, 55>; // 4 x i16 vector value
+def v5i16 : VTVec<5, i16, 56>; // 5 x i16 vector value
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+def v8i16 : VTVec<8, i16, 58>; // 8 x i16 vector value
+def v15i16 : VTVec<15, i16, 59>; // 15 x i16 vector value
+def v16i16 : VTVec<16, i16, 60>; // 16 x i16 vector value
+def v32i16 : VTVec<32, i16, 61>; // 32 x i16 vector value
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+
+def v1i32 : VTVec<1, i32, 66>; // 1 x i32 vector value
+def v2i32 : VTVec<2, i32, 67>; // 2 x i32 vector value
+def v3i32 : VTVec<3, i32, 68>; // 3 x i32 vector value
+def v4i32 : VTVec<4, i32, 69>; // 4 x i32 vector value
+def v5i32 : VTVec<5, i32, 70>; // 5 x i32 vector value
+def v6i32 : VTVec<6, i32, 71>; // 6 x i32 vector value
+def v7i32 : VTVec<7, i32, 72>; // 7 x i32 vector value
+def v8i32 : VTVec<8, i32, 73>; // 8 x i32 vector value
+def v9i32 : VTVec<9, i32, 74>; // 9 x i32 vector value
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+def v11i32 : VTVec<11, i32, 76>; // 11 x i32 vector value
+def v12i32 : VTVec<12, i32, 77>; // 12 x i32 vector value
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+def v16i32 : VTVec<16, i32, 79>; // 16 x i32 vector value
+def v32i32 : VTVec<32, i32, 80>; // 32 x i32 vector value
+def v64i32 : VTVec<64, i32, 81>; // 64 x i32 vector value
+def v128i32 : VTVec<128, i32, 82>; // 128 x i32 vector value
+def v256i32 : VTVec<256, i32, 83>; // 256 x i32 vector value
+def v512i32 : VTVec<512, i32, 84>; // 512 x i32 vector value
+def v1024i32 : VTVec<1024, i32, 85>; // 1024 x i32 vector value
+def v2048i32 : VTVec<2048, i32, 86>; // 2048 x i32 vector value
+
+def v1i64 : VTVec<1, i64, 87>; // 1 x i64 vector value
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+def v4i64 : VTVec<4, i64, 90>; // 4 x i64 vector value
+def v5i64 : VTVec<5, i64, 91>; // 5 x i64 vector value
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+def v8i64 : VTVec<8, i64, 93>; // 8 x i64 vector value
+def v15i64 : VTVec<15, i64, 94>; // 15 x i64 vector value
+def v16i64 : VTVec<16, i64, 95>; // 16 x i64 vector value
+def v32i64 : VTVec<32, i64, 96>; // 32 x i64 vector value
+def v64i64 : VTVec<64, i64, 97>; // 64 x i64 vector value
+def v128i64 : VTVec<128, i64, 98>; // 128 x i64 vector value
+def v256i64 : VTVec<256, i64, 99>; // 256 x i64 vector value
+
+def v1i128 : VTVec<1, i128, 100>; // 1 x i128 vector value
+
+def v1f16 : VTVec<1, f16, 101>; // 1 x f16 vector value
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+def v128f16 : VTVec<128, f16, 112>; // 128 x f16 vector value
+def v256f16 : VTVec<256, f16, 113>; // 256 x f16 vector value
+def v512f16 : VTVec<512, f16, 114>; // 512 x f16 vector value
+
+def v2bf16 : VTVec<2, bf16, 115>; // 2 x bf16 vector value
+def v3bf16 : VTVec<3, bf16, 116>; // 3 x bf16 vector value
+def v4bf16 : VTVec<4, bf16, 117>; // 4 x bf16 vector value
+def v8bf16 : VTVec<8, bf16, 118>; // 8 x bf16 vector value
+def v15bf16 : VTVec<15, bf16, 119>; // 15 x bf16 vector value
+def v16bf16 : VTVec<16, bf16, 120>; // 16 x bf16 vector value
+def v32bf16 : VTVec<32, bf16, 121>; // 32 x bf16 vector value
+def v64bf16 : VTVec<64, bf16, 122>; // 64 x bf16 vector value
+def v128bf16 : VTVec<128, bf16, 123>; // 128 x bf16 vector value
+
+def v1f32 : VTVec<1, f32, 124>; // 1 x f32 vector value
+def v2f32 : VTVec<2, f32, 125>; // 2 x f32 vector value
+def v3f32 : VTVec<3, f32, 126>; // 3 x f32 vector value
+def v4f32 : VTVec<4, f32, 127>; // 4 x f32 vector value
+def v5f32 : VTVec<5, f32, 128>; // 5 x f32 vector value
+def v6f32 : VTVec<6, f32, 129>; // 6 x f32 vector value
+def v7f32 : VTVec<7, f32, 130>; // 7 x f32 vector value
+def v8f32 : VTVec<8, f32, 131>; // 8 x f32 vector value
+def v9f32 : VTVec<9, f32, 132>; // 9 x f32 vector value
+def v10f32 : VTVec<10, f32, 133>; // 10 x f32 vector value
+def v11f32 : VTVec<11, f32, 134>; // 11 x f32 vector value
+def v12f32 : VTVec<12, f32, 135>; // 12 x f32 vector value
+def v15f32 : VTVec<15, f32, 136>; // 15 x f32 vector value
+def v16f32 : VTVec<16, f32, 137>; // 16 x f32 vector value
+def v32f32 : VTVec<32, f32, 138>; // 32 x f32 vector value
+def v64f32 : VTVec<64, f32, 139>; // 64 x f32 vector value
+def v128f32 : VTVec<128, f32, 140>; // 128 x f32 vector value
+def v256f32 : VTVec<256, f32, 141>; // 256 x f32 vector value
+def v512f32 : VTVec<512, f32, 142>; // 512 x f32 vector value
+def v1024f32 : VTVec<1024, f32, 143>; // 1024 x f32 vector value
+def v2048f32 : VTVec<2048, f32, 144>; // 2048 x f32 vector value
+
+def v1f64 : VTVec<1, f64, 145>; // 1 x f64 vector value
+def v2f64 : VTVec<2, f64, 146>; // 2 x f64 vector value
+def v3f64 : VTVec<3, f64, 147>; // 3 x f64 vector value
+def v4f64 : VTVec<4, f64, 148>; // 4 x f64 vector value
+def v5f64 : VTVec<5, f64, 149>; // 5 x f64 vector value
+def v7f64 : VTVec<7, f64, 150>; // 7 x f64 vector value
+def v8f64 : VTVec<8, f64, 151>; // 8 x f64 vector value
+def v15f64 : VTVec<15, f64, 152>; // 15 x f64 vector value
+def v16f64 : VTVec<16, f64, 153>; // 16 x f64 vector value
+def v32f64 : VTVec<32, f64, 154>; // 32 x f64 vector value
+def v64f64 : VTVec<64, f64, 155>; // 64 x f64 vector value
+def v128f64 : VTVec<128, f64, 156>; // 128 x f64 vector value
+def v256f64 : VTVec<256, f64, 157>; // 256 x f64 vector value
+
+def nxv1i1 : VTScalableVec<1, i1, 158>; // n x 1 x i1 vector value
+def nxv2i1 : VTScalableVec<2, i1, 159>; // n x 2 x i1 vector value
+def nxv4i1 : VTScalableVec<4, i1, 160>; // n x 4 x i1 vector value
+def nxv8i1 : VTScalableVec<8, i1, 161>; // n x 8 x i1 vector value
+def nxv16i1 : VTScalableVec<16, i1, 162>; // n x 16 x i1 vector value
+def nxv32i1 : VTScalableVec<32, i1, 163>; // n x 32 x i1 vector value
+def nxv64i1 : VTScalableVec<64, i1, 164>; // n x 64 x i1 vector value
+
+def nxv1i8 : VTScalableVec<1, i8, 165>; // n x 1 x i8 vector value
+def nxv2i8 : VTScalableVec<2, i8, 166>; // n x 2 x i8 vector value
+def nxv4i8 : VTScalableVec<4, i8, 167>; // n x 4 x i8 vector value
+def nxv8i8 : VTScalableVec<8, i8, 168>; // n x 8 x i8 vector value
+def nxv16i8 : VTScalableVec<16, i8, 169>; // n x 16 x i8 vector value
+def nxv32i8 : VTScalableVec<32, i8, 170>; // n x 32 x i8 vector value
+def nxv64i8 : VTScalableVec<64, i8, 171>; // n x 64 x i8 vector value
+
+def nxv1i16 : VTScalableVec<1, i16, 172>; // n x 1 x i16 vector value
+def nxv2i16 : VTScalableVec<2, i16, 173>; // n x 2 x i16 vector value
+def nxv4i16 : VTScalableVec<4, i16, 174>; // n x 4 x i16 vector value
+def nxv8i16 : VTScalableVec<8, i16, 175>; // n x 8 x i16 vector value
+def nxv16i16 : VTScalableVec<16, i16, 176>; // n x 16 x i16 vector value
+def nxv32i16 : VTScalableVec<32, i16, 177>; // n x 32 x i16 vector value
+
+def nxv1i32 : VTScalableVec<1, i32, 178>; // n x 1 x i32 vector value
+def nxv2i32 : VTScalableVec<2, i32, 179>; // n x 2 x i32 vector value
+def nxv4i32 : VTScalableVec<4, i32, 180>; // n x 4 x i32 vector value
+def nxv8i32 : VTScalableVec<8, i32, 181>; // n x 8 x i32 vector value
+def nxv16i32 : VTScalableVec<16, i32, 182>; // n x 16 x i32 vector value
+def nxv32i32 : VTScalableVec<32, i32, 183>; // n x 32 x i32 vector value
+
+def nxv1i64 : VTScalableVec<1, i64, 184>; // n x 1 x i64 vector value
+def nxv2i64 : VTScalableVec<2, i64, 185>; // n x 2 x i64 vector value
+def nxv4i64 : VTScalableVec<4, i64, 186>; // n x 4 x i64 vector value
+def nxv8i64 : VTScalableVec<8, i64, 187>; // n x 8 x i64 vector value
+def nxv16i64 : VTScalableVec<16, i64, 188>; // n x 16 x i64 vector value
+def nxv32i64 : VTScalableVec<32, i64, 189>; // n x 32 x i64 vector value
+
+def nxv1f16 : VTScalableVec<1, f16, 190>; // n x 1 x f16 vector value
+def nxv2f16 : VTScalableVec<2, f16, 191>; // n x 2 x f16 vector value
+def nxv4f16 : VTScalableVec<4, f16, 192>; // n x 4 x f16 vector value
+def nxv8f16 : VTScalableVec<8, f16, 193>; // n x 8 x f16 vector value
+def nxv16f16 : VTScalableVec<16, f16, 194>; // n x 16 x f16 vector value
+def nxv32f16 : VTScalableVec<32, f16, 195>; // n x 32 x f16 vector value
+
+def nxv1bf16 : VTScalableVec<1, bf16, 196>; // n x 1 x bf16 vector value
+def nxv2bf16 : VTScalableVec<2, bf16, 197>; // n x 2 x bf16 vector value
+def nxv4bf16 : VTScalableVec<4, bf16, 198>; // n x 4 x bf16 vector value
+def nxv8bf16 : VTScalableVec<8, bf16, 199>; // n x 8 x bf16 vector value
+def nxv16bf16 : VTScalableVec<16, bf16, 200>; // n x 16 x bf16 vector value
+def nxv32bf16 : VTScalableVec<32, bf16, 201>; // n x 32 x bf16 vector value
+
+def nxv1f32 : VTScalableVec<1, f32, 202>; // n x 1 x f32 vector value
+def nxv2f32 : VTScalableVec<2, f32, 203>; // n x 2 x f32 vector value
+def nxv4f32 : VTScalableVec<4, f32, 204>; // n x 4 x f32 vector value
+def nxv8f32 : VTScalableVec<8, f32, 205>; // n x 8 x f32 vector value
+def nxv16f32 : VTScalableVec<16, f32, 206>; // n x 16 x f32 vector value
+
+def nxv1f64 : VTScalableVec<1, f64, 207>; // n x 1 x f64 vector value
+def nxv2f64 : VTScalableVec<2, f64, 208>; // n x 2 x f64 vector value
+def nxv4f64 : VTScalableVec<4, f64, 209>; // n x 4 x f64 vector value
+def nxv8f64 : VTScalableVec<8, f64, 210>; // n x 8 x f64 vector value
+
+def x86mmx : ValueType<64, 211>; // X86 MMX value
+def FlagVT : ValueType<0, 212> { // Pre-RA sched glue
+ let LLVMName = "Glue";
+}
+def isVoid : ValueType<0, 213>; // Produces no value
+def untyped : ValueType<8, 214> { // Produces an untyped value
let LLVMName = "Untyped";
}
-def funcref : ValueType<0, 194>; // WebAssembly's funcref type
-def externref : ValueType<0, 195>; // WebAssembly's externref type
-def exnref : ValueType<0, 196>; // WebAssembly's exnref type
-def x86amx : ValueType<8192, 197>; // X86 AMX value
-def i64x8 : ValueType<512, 198>; // 8 Consecutive GPRs (AArch64)
+def funcref : ValueType<0, 215>; // WebAssembly's funcref type
+def externref : ValueType<0, 216>; // WebAssembly's externref type
+def exnref : ValueType<0, 217>; // WebAssembly's exnref type
+def x86amx : ValueType<8192, 218>; // X86 AMX value
+def i64x8 : ValueType<512, 219>; // 8 Consecutive GPRs (AArch64)
def aarch64svcount
- : ValueType<16, 199>; // AArch64 predicate-as-counter
-def spirvbuiltin : ValueType<0, 200>; // SPIR-V's builtin type
+ : ValueType<16, 220>; // AArch64 predicate-as-counter
+def spirvbuiltin : ValueType<0, 221>; // SPIR-V's builtin type
----------------
wangpc-pp wrote:
I think we are likely to exceed the maxinum number of ValueType. 😨
https://github.com/llvm/llvm-project/pull/97010
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