[llvm] [ValueTypes] Add v1 to v12 vector type support for i1, i8, i16, f16, … (PR #96481)
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Tue Jun 25 16:26:36 PDT 2024
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-def nxv1bf16 : VTScalableVec<1, bf16, 175>; // n x 1 x bf16 vector value
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-
-def nxv1f32 : VTScalableVec<1, f32, 181>; // n x 1 x f32 vector value
-def nxv2f32 : VTScalableVec<2, f32, 182>; // n x 2 x f32 vector value
-def nxv4f32 : VTScalableVec<4, f32, 183>; // n x 4 x f32 vector value
-def nxv8f32 : VTScalableVec<8, f32, 184>; // n x 8 x f32 vector value
-def nxv16f32 : VTScalableVec<16, f32, 185>; // n x 16 x f32 vector value
-
-def nxv1f64 : VTScalableVec<1, f64, 186>; // n x 1 x f64 vector value
-def nxv2f64 : VTScalableVec<2, f64, 187>; // n x 2 x f64 vector value
-def nxv4f64 : VTScalableVec<4, f64, 188>; // n x 4 x f64 vector value
-def nxv8f64 : VTScalableVec<8, f64, 189>; // n x 8 x f64 vector value
-
-def x86mmx : ValueType<64, 190>; // X86 MMX value
-def Glue : ValueType<0, 191>; // Pre-RA sched glue
-def isVoid : ValueType<0, 192>; // Produces no value
-def untyped : ValueType<8, 193> { // Produces an untyped value
+def v5i1 : VTVec<5, i1, 21>; // 5 x i1 vector value
+def v6i1 : VTVec<6, i1, 22>; // 6 x i1 vector value
+def v7i1 : VTVec<7, i1, 23>; // 7 x i1 vector value
+def v8i1 : VTVec<8, i1, 24>; // 8 x i1 vector value
+def v9i1 : VTVec<9, i1, 25>; // 9 x i1 vector value
+def v10i1 : VTVec<10, i1, 26>; // 10 x i1 vector value
+def v11i1 : VTVec<11, i1, 27>; // 11 x i1 vector value
+def v12i1 : VTVec<12, i1, 28>; // 12 x i1 vector value
+def v16i1 : VTVec<16, i1, 29>; // 16 x i1 vector value
+def v32i1 : VTVec<32, i1, 30>; // 32 x i1 vector value
+def v64i1 : VTVec<64, i1, 31>; // 64 x i1 vector value
+def v128i1 : VTVec<128, i1, 32>; // 128 x i1 vector value
+def v256i1 : VTVec<256, i1, 33>; // 256 x i1 vector value
+def v512i1 : VTVec<512, i1, 34>; // 512 x i1 vector value
+def v1024i1 : VTVec<1024, i1, 35>; // 1024 x i1 vector value
+def v2048i1 : VTVec<2048, i1, 36>; // 2048 x i1 vector value
+
+def v128i2 : VTVec<128, i2, 37>; // 128 x i2 vector value
+def v256i2 : VTVec<256, i2, 38>; // 256 x i2 vector value
+
+def v64i4 : VTVec<64, i4, 39>; // 64 x i4 vector value
+def v128i4 : VTVec<128, i4, 40>; // 128 x i4 vector value
+
+def v1i8 : VTVec<1, i8, 41>; // 1 x i8 vector value
+def v2i8 : VTVec<2, i8, 42>; // 2 x i8 vector value
+def v3i8 : VTVec<3, i8, 43>; // 3 x i8 vector value
+def v4i8 : VTVec<4, i8, 44>; // 4 x i8 vector value
+def v5i8 : VTVec<5, i8, 45>; // 5 x i8 vector value
+def v6i8 : VTVec<6, i8, 46>; // 6 x i8 vector value
+def v7i8 : VTVec<7, i8, 47>; // 7 x i8 vector value
+def v8i8 : VTVec<8, i8, 48>; // 8 x i8 vector value
+def v9i8 : VTVec<9, i8, 49>; // 9 x i8 vector value
+def v10i8 : VTVec<10, i8, 50>; // 10 x i8 vector value
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+
+def v1i16 : VTVec<1, i16, 60>; // 1 x i16 vector value
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+def v128i64 : VTVec<128, i64, 113>; // 128 x i64 vector value
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+
+def v1i128 : VTVec<1, i128, 115>; // 1 x i128 vector value
+
+def v1f16 : VTVec<1, f16, 116>; // 1 x f16 vector value
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+
+def v2bf16 : VTVec<2, bf16, 134>; // 2 x bf16 vector value
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+
+def v1f32 : VTVec<1, f32, 142>; // 1 x f32 vector value
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+def v1024f32 : VTVec<1024, f32, 160>; // 1024 x f32 vector value
+def v2048f32 : VTVec<2048, f32, 161>; // 2048 x f32 vector value
+
+def v1f64 : VTVec<1, f64, 162>; // 1 x f64 vector value
+def v2f64 : VTVec<2, f64, 163>; // 2 x f64 vector value
+def v3f64 : VTVec<3, f64, 164>; // 3 x f64 vector value
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+def v256f64 : VTVec<256, f64, 178>; // 256 x f64 vector value
+
+def nxv1i1 : VTScalableVec<1, i1, 179>; // n x 1 x i1 vector value
+def nxv2i1 : VTScalableVec<2, i1, 180>; // n x 2 x i1 vector value
+def nxv4i1 : VTScalableVec<4, i1, 181>; // n x 4 x i1 vector value
+def nxv8i1 : VTScalableVec<8, i1, 182>; // n x 8 x i1 vector value
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+
+def nxv1i8 : VTScalableVec<1, i8, 186>; // n x 1 x i8 vector value
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+def nxv4i8 : VTScalableVec<4, i8, 188>; // n x 4 x i8 vector value
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+def nxv32i8 : VTScalableVec<32, i8, 191>; // n x 32 x i8 vector value
+def nxv64i8 : VTScalableVec<64, i8, 192>; // n x 64 x i8 vector value
+
+def nxv1i16 : VTScalableVec<1, i16, 193>; // n x 1 x i16 vector value
+def nxv2i16 : VTScalableVec<2, i16, 194>; // n x 2 x i16 vector value
+def nxv4i16 : VTScalableVec<4, i16, 195>; // n x 4 x i16 vector value
+def nxv8i16 : VTScalableVec<8, i16, 196>; // n x 8 x i16 vector value
+def nxv16i16 : VTScalableVec<16, i16, 197>; // n x 16 x i16 vector value
+def nxv32i16 : VTScalableVec<32, i16, 198>; // n x 32 x i16 vector value
+
+def nxv1i32 : VTScalableVec<1, i32, 199>; // n x 1 x i32 vector value
+def nxv2i32 : VTScalableVec<2, i32, 200>; // n x 2 x i32 vector value
+def nxv4i32 : VTScalableVec<4, i32, 201>; // n x 4 x i32 vector value
+def nxv8i32 : VTScalableVec<8, i32, 202>; // n x 8 x i32 vector value
+def nxv16i32 : VTScalableVec<16, i32, 203>; // n x 16 x i32 vector value
+def nxv32i32 : VTScalableVec<32, i32, 204>; // n x 32 x i32 vector value
+
+def nxv1i64 : VTScalableVec<1, i64, 205>; // n x 1 x i64 vector value
+def nxv2i64 : VTScalableVec<2, i64, 206>; // n x 2 x i64 vector value
+def nxv4i64 : VTScalableVec<4, i64, 207>; // n x 4 x i64 vector value
+def nxv8i64 : VTScalableVec<8, i64, 208>; // n x 8 x i64 vector value
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+def nxv32i64 : VTScalableVec<32, i64, 210>; // n x 32 x i64 vector value
+
+def nxv1f16 : VTScalableVec<1, f16, 211>; // n x 1 x f16 vector value
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+def nxv4f16 : VTScalableVec<4, f16, 213>; // n x 4 x f16 vector value
+def nxv8f16 : VTScalableVec<8, f16, 214>; // n x 8 x f16 vector value
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+def nxv32f16 : VTScalableVec<32, f16, 216>; // n x 32 x f16 vector value
+
+def nxv1bf16 : VTScalableVec<1, bf16, 217>; // n x 1 x bf16 vector value
+def nxv2bf16 : VTScalableVec<2, bf16, 218>; // n x 2 x bf16 vector value
+def nxv4bf16 : VTScalableVec<4, bf16, 219>; // n x 4 x bf16 vector value
+def nxv8bf16 : VTScalableVec<8, bf16, 220>; // n x 8 x bf16 vector value
+def nxv16bf16 : VTScalableVec<16, bf16, 221>; // n x 16 x bf16 vector value
+def nxv32bf16 : VTScalableVec<32, bf16, 222>; // n x 32 x bf16 vector value
+
+def nxv1f32 : VTScalableVec<1, f32, 223>; // n x 1 x f32 vector value
+def nxv2f32 : VTScalableVec<2, f32, 224>; // n x 2 x f32 vector value
+def nxv4f32 : VTScalableVec<4, f32, 225>; // n x 4 x f32 vector value
+def nxv8f32 : VTScalableVec<8, f32, 226>; // n x 8 x f32 vector value
+def nxv16f32 : VTScalableVec<16, f32, 227>; // n x 16 x f32 vector value
+
+def nxv1f64 : VTScalableVec<1, f64, 228>; // n x 1 x f64 vector value
+def nxv2f64 : VTScalableVec<2, f64, 229>; // n x 2 x f64 vector value
+def nxv4f64 : VTScalableVec<4, f64, 230>; // n x 4 x f64 vector value
+def nxv8f64 : VTScalableVec<8, f64, 231>; // n x 8 x f64 vector value
+def nxv16f64 : VTScalableVec<16, f64, 232>; // n x 16 x f64 vector value
+
+def x86mmx : ValueType<64, 233>; // X86 MMX value
+def Glue : ValueType<0, 234>; // Pre-RA sched glue
+def isVoid : ValueType<0, 235>; // Produces no value
+def untyped : ValueType<8, 236> { // Produces an untyped value
let LLVMName = "Untyped";
}
-def funcref : ValueType<0, 194>; // WebAssembly's funcref type
-def externref : ValueType<0, 195>; // WebAssembly's externref type
-def exnref : ValueType<0, 196>; // WebAssembly's exnref type
-def x86amx : ValueType<8192, 197>; // X86 AMX value
-def i64x8 : ValueType<512, 198>; // 8 Consecutive GPRs (AArch64)
+def funcref : ValueType<0, 237>; // WebAssembly's funcref type
+def externref : ValueType<0, 238>; // WebAssembly's externref type
+def exnref : ValueType<0, 239>; // WebAssembly's exnref type
+def x86amx : ValueType<8192, 240>; // X86 AMX value
+def i64x8 : ValueType<512, 241>; // 8 Consecutive GPRs (AArch64)
def aarch64svcount
- : ValueType<16, 199>; // AArch64 predicate-as-counter
-def spirvbuiltin : ValueType<0, 200>; // SPIR-V's builtin type
+ : ValueType<16, 242>; // AArch64 predicate-as-counter
+def spirvbuiltin : ValueType<0, 243>; // SPIR-V's builtin type
----------------
topperc wrote:
I'm very concerned that there are only 4 types left.
https://github.com/llvm/llvm-project/pull/96481
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