[llvm] [CodeGen] Add <4096 x i32> value type (PR #143417)
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llvm-commits at lists.llvm.org
Mon Jun 9 11:07:19 PDT 2025
llvmbot wrote:
<!--LLVM PR SUMMARY COMMENT-->
@llvm/pr-subscribers-llvm-ir
Author: Chenguang Wang (wecing)
<details>
<summary>Changes</summary>
Similar to https://github.com/llvm/llvm-project/pull/139294; just realized we need this as well.
---
Patch is 26.53 KiB, truncated to 20.00 KiB below, full version: https://github.com/llvm/llvm-project/pull/143417.diff
2 Files Affected:
- (modified) llvm/include/llvm/CodeGen/ValueTypes.td (+179-178)
- (modified) llvm/include/llvm/IR/Intrinsics.td (+4-3)
``````````diff
diff --git a/llvm/include/llvm/CodeGen/ValueTypes.td b/llvm/include/llvm/CodeGen/ValueTypes.td
index 1e9632357edd0..4551e7e4b9b60 100644
--- a/llvm/include/llvm/CodeGen/ValueTypes.td
+++ b/llvm/include/llvm/CodeGen/ValueTypes.td
@@ -155,194 +155,195 @@ def v256i32 : VTVec<256, i32, 75>; // 256 x i32 vector value
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+def nxv8i32 : VTScalableVec<8, i32, 166>; // n x 8 x i32 vector value
+def nxv16i32 : VTScalableVec<16, i32, 167>; // n x 16 x i32 vector value
+def nxv32i32 : VTScalableVec<32, i32, 168>; // n x 32 x i32 vector value
+
+def nxv1i64 : VTScalableVec<1, i64, 169>; // n x 1 x i64 vector value
+def nxv2i64 : VTScalableVec<2, i64, 170>; // n x 2 x i64 vector value
+def nxv4i64 : VTScalableVec<4, i64, 171>; // n x 4 x i64 vector value
+def nxv8i64 : VTScalableVec<8, i64, 172>; // n x 8 x i64 vector value
+def nxv16i64 : VTScalableVec<16, i64, 173>; // n x 16 x i64 vector value
+def nxv32i64 : VTScalableVec<32, i64, 174>; // n x 32 x i64 vector value
+
+def nxv1f16 : VTScalableVec<1, f16, 175>; // n x 1 x f16 vector value
+def nxv2f16 : VTScalableVec<2, f16, 176>; // n x 2 x f16 vector value
+def nxv4f16 : VTScalableVec<4, f16, 177>; // n x 4 x f16 vector value
+def nxv8f16 : VTScalableVec<8, f16, 178>; // n x 8 x f16 vector value
+def nxv16f16 : VTScalableVec<16, f16, 179>; // n x 16 x f16 vector value
+def nxv32f16 : VTScalableVec<32, f16, 180>; // n x 32 x f16 vector value
+
+def nxv1bf16 : VTScalableVec<1, bf16, 181>; // n x 1 x bf16 vector value
+def nxv2bf16 : VTScalableVec<2, bf16, 182>; // n x 2 x bf16 vector value
+def nxv4bf16 : VTScalableVec<4, bf16, 183>; // n x 4 x bf16 vector value
+def nxv8bf16 : VTScalableVec<8, bf16, 184>; // n x 8 x bf16 vector value
+def nxv16bf16 : VTScalableVec<16, bf16, 185>; // n x 16 x bf16 vector value
+def nxv32bf16 : VTScalableVec<32, bf16, 186>; // n x 32 x bf16 vector value
+
+def nxv1f32 : VTScalableVec<1, f32, 187>; // n x 1 x f32 vector value
+def nxv2f32 : VTScalableVec<2, f32, 188>; // n x 2 x f32 vector value
+def nxv4f32 : VTScalableVec<4, f32, 189>; // n x 4 x f32 vector value
+def nxv8f32 : VTScalableVec<8, f32, 190>; // n x 8 x f32 vector value
+def nxv16f32 : VTScalableVec<16, f32, 191>; // n x 16 x f32 vector value
+
+def nxv1f64 : VTScalableVec<1, f64, 192>; // n x 1 x f64 vector value
+def nxv2f64 : VTScalableVec<2, f64, 193>; // n x 2 x f64 vector value
+def nxv4f64 : VTScalableVec<4, f64, 194>; // n x 4 x f64 vector value
+def nxv8f64 : VTScalableVec<8, f64, 195>; // n x 8 x f64 vector value
// Sz = NF * MinNumElts * 8(bits)
-def riscv_nxv1i8x2 : VTVecTup<16, 2, i8, 195>; // RISCV vector tuple(min_num_elts=1, nf=2)
-def riscv_nxv1i8x3 : VTVecTup<24, 3, i8, 196>; // RISCV vector tuple(min_num_elts=1, nf=3)
-def riscv_nxv1i8x4 : VTVecTup<32, 4, i8, 197>; // RISCV vector tuple(min_num_elts=1, nf=4)
-def riscv_nxv1i8x5 : VTVecTup<40, 5, i8, 198>; // RISCV vector tuple(min_num_elts=1, nf=5)
-def riscv_nxv1i8x6 : VTVecTup<48, 6, i8, 199>; // RISCV vector tuple(min_num_elts=1, nf=6)
-def riscv_nxv1i8x7 : VTVecTup<56, 7, i8, 200>; // RISCV vector tuple(min_num_elts=1, nf=7)
-def riscv_nxv1i8x8 : VTVecTup<64, 8, i8, 201>; // RISCV vector tuple(min_num_elts=1, nf=8)
-def riscv_nxv2i8x2 : VTVecTup<32, 2, i8, 202>; // RISCV vector tuple(min_num_elts=2, nf=2)
-def riscv_nxv2i8x3 : VTVecTup<48, 3, i8, 203>; // RISCV vector tuple(min_num_elts=2, nf=3)
-def riscv_nxv2i8x4 : VTVecTup<64, 4, i8, 204>; // RISCV vector tuple(min_num_elts=2, nf=4)
-def riscv_nxv2i8x5 : VTVecTup<80, 5, i8, 205>; // RISCV vector tuple(min_num_elts=2, nf=5)
-def riscv_nxv2i8x6 : VTVecTup<96, 6, i8, 206>; // RISCV vector tuple(min_num_elts=2, nf=6)
-def riscv_nxv2i8x7 : VTVecTup<112, 7, i8, 207>; // RISCV vector tuple(min_num_elts=2, nf=7)
-def riscv_nxv2i8x8 : VTVecTup<128, 8, i8, 208>; // RISCV vector tuple(min_num_elts=2, nf=8)
-def riscv_nxv4i8x2 : VTVecTup<64, 2, i8, 209>; // RISCV vector tuple(min_num_elts=4, nf=2)
-def riscv_nxv4i8x3 : VTVecTup<96, 3, i8, 210>; // RISCV vector tuple(min_num_elts=4, nf=3)
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-def riscv_nxv4i8x5 : VTVecTup<160, 5, i8, 212>; // RISCV vector tuple(min_num_elts=4, nf=5)
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-def riscv_nxv8i8x2 : VTVecTup<128, 2, i8, 216>; // RISCV vector tuple(min_num_elts=8, nf=2)
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-def riscv_nxv8i8x5 : VTVecTup<320, 5, i8, 219>; // RISCV vector tuple(min_num_elts=8, nf=5)
-def riscv_nxv8i8x6 : VTVecTup<384, 6, i8, 220>; // RISCV vector tuple(min_num_elts=8, nf=6)
-def riscv_nxv8i8x7 : VTVecTup<448, 7, i8, 221>; // RISCV vector tuple(min_num_elts=8, nf=7)
-def riscv_nxv8i8x8 : VTVecTup<512, 8, i8, 222>; // RISCV vector tuple(min_num_elts=8, nf=8)
-def riscv_nxv16i8x2 : VTVecTup<256, 2, i8, 223>; // RISCV vector tuple(min_num_elts=16, nf=2)
-def riscv_nxv16i8x3 : VTVecTup<384, 3, i8, 224>; // RISCV vector tuple(min_num_elts=16, nf=3)
-def riscv_nxv16i8x4 : VTVecTup<512, 4, i8, 225>; // RISCV vector tuple(min_num_elts=16, nf=4)
-def riscv_nxv32i8x2 : VTVecTup<512, 2, i8, 226>; // RISCV vector tuple(min_num_elts=32, nf=2)
-
-def x86mmx : ValueType<64, 227>; // X86 MMX value
-def Glue : ValueType<0, 228>; // Pre-RA sched glue
-def isVoid : ValueType<0, 229>; // Produces no value
-def untyped : ValueType<8, 230> { // Produces an untyped value
+def riscv_nxv1i8x2 : VTVecTup<16, 2, i8, 196>; // RISCV vector tup...
[truncated]
``````````
</details>
https://github.com/llvm/llvm-project/pull/143417
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