<div dir="ltr"><div dir="ltr">I believe there is probably a separate instruction in LLVM for thumb2 add. Probably starting with t2 instead of t.<div><br></div><div>The definition of tADDi8 looks like this. Where tGPR specifically means R0-R7.</div><div><br></div><div><div>  def tADDi8 :                    // A8.6.4 T2</div><div>    T1sItGenEncodeImm<{1,1,0,?,?}, (outs tGPR:$Rdn),</div><div>                      (ins tGPR:$Rn, imm0_255:$imm8), IIC_iALUi,</div><div>                      "add", "\t$Rdn, $imm8",</div><div>                      [(set tGPR:$Rdn, (add tGPR:$Rn, imm8_255:$imm8))]>,</div><div>                      Sched<[WriteALU]>;</div><div><br clear="all"><div><div dir="ltr" class="gmail_signature">~Craig</div></div><br></div></div></div></div><br><div class="gmail_quote"><div dir="ltr" class="gmail_attr">On Sun, Apr 14, 2019 at 12:21 PM Jie Zhou <<a href="mailto:jzhou41@cs.rochester.edu">jzhou41@cs.rochester.edu</a>> wrote:<br></div><blockquote class="gmail_quote" style="margin:0px 0px 0px 0.8ex;border-left:1px solid rgb(204,204,204);padding-left:1ex">



<div style="overflow-wrap: break-word;">
Sorry for not being specific enough. ARMv7-M includes Thumb and Thumb2. 
<div>It has 12 regular registers (R0 - R12), and R8 - R12 are used. </div>
<div>I can generate mov instruction that from/ R8-R12 to/from R0-R6. </div>
<div>From this ARM page <a href="http://infocenter.arm.com/help/index.jsp?topic=/com.arm.doc.dui0068b/ch03s03s01.html" target="_blank">http://infocenter.arm.com/help/index.jsp?topic=/com.arm.doc.dui0068b/ch03s03s01.html</a></div>
<div>R9 - R12 have their conventional usage, but I don’t if this is the reason we cannot </div>
<div>use them arbitrarily. The fact that we can use it to generate mov instructions but</div>
<div>not add/sub and push/pop confuses me.</div>
<div><br>
</div>
<div>- Jie<br>
<div><br>
<blockquote type="cite">
<div>On Apr 14, 2019, at 14:55, Craig Topper <<a href="mailto:craig.topper@gmail.com" target="_blank">craig.topper@gmail.com</a>> wrote:</div>
<br class="gmail-m_4679658289449006096Apple-interchange-newline">
<div>
<div dir="ltr">I don't know much about ARM. But it looks like tADDi8 is a Thumb instruction and it can only use R0-R7.
<div><br>
</div>
<div>tPUSH probably as a similar issue. But it's also a store instruction and doesn't produce a register output. So you should use the form of BuildMI that doesn't take a register as its last argument.<br>
<div><br clear="all">
<div>
<div dir="ltr" class="gmail-m_4679658289449006096gmail_signature">~Craig</div>
</div>
<br>
</div>
</div>
</div>
<br>
<div class="gmail_quote">
<div dir="ltr" class="gmail_attr">On Sun, Apr 14, 2019 at 11:17 AM Jie Zhou via llvm-dev <<a href="mailto:llvm-dev@lists.llvm.org" target="_blank">llvm-dev@lists.llvm.org</a>> wrote:<br>
</div>
<blockquote class="gmail_quote" style="margin:0px 0px 0px 0.8ex;border-left:1px solid rgb(204,204,204);padding-left:1ex">
Hi all,<br>
<br>
I’m trying to insert some add/sub and push/pop instructions in a MachineFunction pass for ARMv7-M. However, I encountered something weird.<br>
For an add, when I use <br>
<br>
        BuildMI(….., TII->get(ARM::tADDi8), reg).addReg(reg).addReg(reg).addImm(imm).<br>
<br>
if reg is R0 - R7, everything is fine: I would get something like<br>
<br>
        adds r1, 4<br>
<br>
But if I use R8 - R12 as the reg in the BuildMI, I wouldn’t get the correct register in the assembly code. For example, when I pass R8 to it, I would get
<br>
<br>
        adds r0, 4<br>
<br>
rather than<br>
<br>
        adds r8, 4.<br>
<br>
Similar problems happen to push and pop instructions. I can create a push/pop if the register list only contains registers R0 - R7, but<br>
for registers whose number are greater than R7, the generated asm code doesn’t have it. For example,
<br>
<br>
        BuildMI(……, TII->get(ARM::tPUSH), R8)…..<br>
<br>
would give me <br>
<br>
        push {}<br>
<br>
Is this a bug in the LLVM ARM code generator? Or is there a reason why we cannot use big-number registers for add/sub and push/pop?
<br>
<br>
Thanks,<br>
- Jie<br>
_______________________________________________<br>
LLVM Developers mailing list<br>
<a href="mailto:llvm-dev@lists.llvm.org" target="_blank">llvm-dev@lists.llvm.org</a><br>
<a href="https://urldefense.proofpoint.com/v2/url?u=https-3A__lists.llvm.org_cgi-2Dbin_mailman_listinfo_llvm-2Ddev&d=DwMFaQ&c=kbmfwr1Yojg42sGEpaQh5ofMHBeTl9EI2eaqQZhHbOU&r=KAtyTEI8n3FritxDpKpR7rv3VjdmUs0luiVKZLb_bNI&m=U3D9KaSPCCtUPKPRKsCQl1uo2Kf6PSTT60lRuM6LGO8&s=VbLOmjk6zGsqyFH-PkHGWi4G9iNb4k60I8byBoTgJN4&e=" rel="noreferrer" target="_blank">https://lists.llvm.org/cgi-bin/mailman/listinfo/llvm-dev</a><br>
</blockquote>
</div>
</div>
</blockquote>
</div>
<br>
</div>
</div>

</blockquote></div>