<div dir="ltr">This test case is...huge. I know that it has to be larger than your average test since it is precisely testing behavior in case of a spill, but is there a more principled and compact way to create a large number of live variables? It seems like this is just a dump of an offending code fragment. Have you tried to see how much bugpoint is able to shave off? At the very least, the control flow doesn't seem necessary.<div>
<br></div><div>-- Sean Silva</div></div><div class="gmail_extra"><br><br><div class="gmail_quote">On Wed, Nov 27, 2013 at 4:23 PM, Tom Stellard <span dir="ltr"><<a href="mailto:thomas.stellard@amd.com" target="_blank">thomas.stellard@amd.com</a>></span> wrote:<br>
<blockquote class="gmail_quote" style="margin:0 0 0 .8ex;border-left:1px #ccc solid;padding-left:1ex">Author: tstellar<br>
Date: Wed Nov 27 15:23:29 2013<br>
New Revision: 195879<br>
<br>
URL: <a href="http://llvm.org/viewvc/llvm-project?rev=195879&view=rev" target="_blank">http://llvm.org/viewvc/llvm-project?rev=195879&view=rev</a><br>
Log:<br>
R600/SI: Use SGPR_32 register class for 32-bit SMRD outputs<br>
<br>
Writing to the M0 register from an SMRD instruction hangs the GPU, so<br>
we need to use the SGPR_32 register class, which does not include M0.<br>
<br>
NOTE: This is a candidate for the 3.4 branch.<br>
<br>
Added:<br>
llvm/trunk/test/CodeGen/R600/si-sgpr-spill.ll<br>
Modified:<br>
llvm/trunk/lib/Target/R600/SIInstructions.td<br>
<br>
Modified: llvm/trunk/lib/Target/R600/SIInstructions.td<br>
URL: <a href="http://llvm.org/viewvc/llvm-project/llvm/trunk/lib/Target/R600/SIInstructions.td?rev=195879&r1=195878&r2=195879&view=diff" target="_blank">http://llvm.org/viewvc/llvm-project/llvm/trunk/lib/Target/R600/SIInstructions.td?rev=195879&r1=195878&r2=195879&view=diff</a><br>
==============================================================================<br>
--- llvm/trunk/lib/Target/R600/SIInstructions.td (original)<br>
+++ llvm/trunk/lib/Target/R600/SIInstructions.td Wed Nov 27 15:23:29 2013<br>
@@ -489,14 +489,17 @@ def TBUFFER_STORE_FORMAT_XYZW : MTBUF_St<br>
<br>
let mayLoad = 1 in {<br>
<br>
-defm S_LOAD_DWORD : SMRD_Helper <0x00, "S_LOAD_DWORD", SReg_64, SReg_32>;<br>
+// We are using the SGPR_32 and not the SReg_32 register class for 32-bit<br>
+// SMRD instructions, because the SGPR_32 register class does not include M0<br>
+// and writing to M0 from an SMRD instruction will hang the GPU.<br>
+defm S_LOAD_DWORD : SMRD_Helper <0x00, "S_LOAD_DWORD", SReg_64, SGPR_32>;<br>
defm S_LOAD_DWORDX2 : SMRD_Helper <0x01, "S_LOAD_DWORDX2", SReg_64, SReg_64>;<br>
defm S_LOAD_DWORDX4 : SMRD_Helper <0x02, "S_LOAD_DWORDX4", SReg_64, SReg_128>;<br>
defm S_LOAD_DWORDX8 : SMRD_Helper <0x03, "S_LOAD_DWORDX8", SReg_64, SReg_256>;<br>
defm S_LOAD_DWORDX16 : SMRD_Helper <0x04, "S_LOAD_DWORDX16", SReg_64, SReg_512>;<br>
<br>
defm S_BUFFER_LOAD_DWORD : SMRD_Helper <<br>
- 0x08, "S_BUFFER_LOAD_DWORD", SReg_128, SReg_32<br>
+ 0x08, "S_BUFFER_LOAD_DWORD", SReg_128, SGPR_32<br>
>;<br>
<br>
defm S_BUFFER_LOAD_DWORDX2 : SMRD_Helper <<br>
<br>
Added: llvm/trunk/test/CodeGen/R600/si-sgpr-spill.ll<br>
URL: <a href="http://llvm.org/viewvc/llvm-project/llvm/trunk/test/CodeGen/R600/si-sgpr-spill.ll?rev=195879&view=auto" target="_blank">http://llvm.org/viewvc/llvm-project/llvm/trunk/test/CodeGen/R600/si-sgpr-spill.ll?rev=195879&view=auto</a><br>
==============================================================================<br>
--- llvm/trunk/test/CodeGen/R600/si-sgpr-spill.ll (added)<br>
+++ llvm/trunk/test/CodeGen/R600/si-sgpr-spill.ll Wed Nov 27 15:23:29 2013<br>
@@ -0,0 +1,692 @@<br>
+; RUN: llc -march=r600 -mcpu=SI < %s | FileCheck %s<br>
+<br>
+; XXX: Enable when spilling is supported<br>
+; XFAIL: *<br>
+<br>
+; These tests check that the compiler won't crash when it needs to spill<br>
+; SGPRs.<br>
+<br>
+; CHECK-LABEL: @main<br>
+; Writing to M0 from an SMRD instruction will hang the GPU.<br>
+; CHECK-NOT: S_BUFFER_LOAD_DWORD m0<br>
+; CHECK: S_ENDPGM<br>
+@ddxy_lds = external addrspace(3) global [64 x i32]<br>
+<br>
+define void @main([17 x <16 x i8>] addrspace(2)* byval, [32 x <16 x i8>] addrspace(2)* byval, [16 x <32 x i8>] addrspace(2)* byval, float inreg, i32 inreg, <2 x i32>, <2 x i32>, <2 x i32>, <3 x i32>, <2 x i32>, <2 x i32>, <2 x i32>, float, float, float, float, float, float, float, float, float) #0 {<br>
+main_body:<br>
+ %21 = getelementptr [17 x <16 x i8>] addrspace(2)* %0, i64 0, i32 0<br>
+ %22 = load <16 x i8> addrspace(2)* %21, !tbaa !0<br>
+ %23 = call float @llvm.SI.load.const(<16 x i8> %22, i32 96)<br>
+ %24 = call float @llvm.SI.load.const(<16 x i8> %22, i32 100)<br>
+ %25 = call float @llvm.SI.load.const(<16 x i8> %22, i32 104)<br>
+ %26 = call float @llvm.SI.load.const(<16 x i8> %22, i32 112)<br>
+ %27 = call float @llvm.SI.load.const(<16 x i8> %22, i32 116)<br>
+ %28 = call float @llvm.SI.load.const(<16 x i8> %22, i32 120)<br>
+ %29 = call float @llvm.SI.load.const(<16 x i8> %22, i32 128)<br>
+ %30 = call float @llvm.SI.load.const(<16 x i8> %22, i32 132)<br>
+ %31 = call float @llvm.SI.load.const(<16 x i8> %22, i32 140)<br>
+ %32 = call float @llvm.SI.load.const(<16 x i8> %22, i32 144)<br>
+ %33 = call float @llvm.SI.load.const(<16 x i8> %22, i32 160)<br>
+ %34 = call float @llvm.SI.load.const(<16 x i8> %22, i32 176)<br>
+ %35 = call float @llvm.SI.load.const(<16 x i8> %22, i32 180)<br>
+ %36 = call float @llvm.SI.load.const(<16 x i8> %22, i32 184)<br>
+ %37 = call float @llvm.SI.load.const(<16 x i8> %22, i32 192)<br>
+ %38 = call float @llvm.SI.load.const(<16 x i8> %22, i32 196)<br>
+ %39 = call float @llvm.SI.load.const(<16 x i8> %22, i32 200)<br>
+ %40 = call float @llvm.SI.load.const(<16 x i8> %22, i32 208)<br>
+ %41 = call float @llvm.SI.load.const(<16 x i8> %22, i32 212)<br>
+ %42 = call float @llvm.SI.load.const(<16 x i8> %22, i32 216)<br>
+ %43 = call float @llvm.SI.load.const(<16 x i8> %22, i32 224)<br>
+ %44 = call float @llvm.SI.load.const(<16 x i8> %22, i32 240)<br>
+ %45 = call float @llvm.SI.load.const(<16 x i8> %22, i32 244)<br>
+ %46 = call float @llvm.SI.load.const(<16 x i8> %22, i32 248)<br>
+ %47 = call float @llvm.SI.load.const(<16 x i8> %22, i32 256)<br>
+ %48 = call float @llvm.SI.load.const(<16 x i8> %22, i32 272)<br>
+ %49 = call float @llvm.SI.load.const(<16 x i8> %22, i32 276)<br>
+ %50 = call float @llvm.SI.load.const(<16 x i8> %22, i32 280)<br>
+ %51 = call float @llvm.SI.load.const(<16 x i8> %22, i32 288)<br>
+ %52 = call float @llvm.SI.load.const(<16 x i8> %22, i32 292)<br>
+ %53 = call float @llvm.SI.load.const(<16 x i8> %22, i32 296)<br>
+ %54 = call float @llvm.SI.load.const(<16 x i8> %22, i32 304)<br>
+ %55 = call float @llvm.SI.load.const(<16 x i8> %22, i32 308)<br>
+ %56 = call float @llvm.SI.load.const(<16 x i8> %22, i32 312)<br>
+ %57 = call float @llvm.SI.load.const(<16 x i8> %22, i32 368)<br>
+ %58 = call float @llvm.SI.load.const(<16 x i8> %22, i32 372)<br>
+ %59 = call float @llvm.SI.load.const(<16 x i8> %22, i32 376)<br>
+ %60 = call float @llvm.SI.load.const(<16 x i8> %22, i32 384)<br>
+ %61 = getelementptr [16 x <32 x i8>] addrspace(2)* %2, i64 0, i32 0<br>
+ %62 = load <32 x i8> addrspace(2)* %61, !tbaa !0<br>
+ %63 = getelementptr [32 x <16 x i8>] addrspace(2)* %1, i64 0, i32 0<br>
+ %64 = load <16 x i8> addrspace(2)* %63, !tbaa !0<br>
+ %65 = getelementptr [16 x <32 x i8>] addrspace(2)* %2, i64 0, i32 1<br>
+ %66 = load <32 x i8> addrspace(2)* %65, !tbaa !0<br>
+ %67 = getelementptr [32 x <16 x i8>] addrspace(2)* %1, i64 0, i32 1<br>
+ %68 = load <16 x i8> addrspace(2)* %67, !tbaa !0<br>
+ %69 = getelementptr [16 x <32 x i8>] addrspace(2)* %2, i64 0, i32 2<br>
+ %70 = load <32 x i8> addrspace(2)* %69, !tbaa !0<br>
+ %71 = getelementptr [32 x <16 x i8>] addrspace(2)* %1, i64 0, i32 2<br>
+ %72 = load <16 x i8> addrspace(2)* %71, !tbaa !0<br>
+ %73 = getelementptr [16 x <32 x i8>] addrspace(2)* %2, i64 0, i32 3<br>
+ %74 = load <32 x i8> addrspace(2)* %73, !tbaa !0<br>
+ %75 = getelementptr [32 x <16 x i8>] addrspace(2)* %1, i64 0, i32 3<br>
+ %76 = load <16 x i8> addrspace(2)* %75, !tbaa !0<br>
+ %77 = getelementptr [16 x <32 x i8>] addrspace(2)* %2, i64 0, i32 4<br>
+ %78 = load <32 x i8> addrspace(2)* %77, !tbaa !0<br>
+ %79 = getelementptr [32 x <16 x i8>] addrspace(2)* %1, i64 0, i32 4<br>
+ %80 = load <16 x i8> addrspace(2)* %79, !tbaa !0<br>
+ %81 = getelementptr [16 x <32 x i8>] addrspace(2)* %2, i64 0, i32 5<br>
+ %82 = load <32 x i8> addrspace(2)* %81, !tbaa !0<br>
+ %83 = getelementptr [32 x <16 x i8>] addrspace(2)* %1, i64 0, i32 5<br>
+ %84 = load <16 x i8> addrspace(2)* %83, !tbaa !0<br>
+ %85 = getelementptr [16 x <32 x i8>] addrspace(2)* %2, i64 0, i32 6<br>
+ %86 = load <32 x i8> addrspace(2)* %85, !tbaa !0<br>
+ %87 = getelementptr [32 x <16 x i8>] addrspace(2)* %1, i64 0, i32 6<br>
+ %88 = load <16 x i8> addrspace(2)* %87, !tbaa !0<br>
+ %89 = getelementptr [16 x <32 x i8>] addrspace(2)* %2, i64 0, i32 7<br>
+ %90 = load <32 x i8> addrspace(2)* %89, !tbaa !0<br>
+ %91 = getelementptr [32 x <16 x i8>] addrspace(2)* %1, i64 0, i32 7<br>
+ %92 = load <16 x i8> addrspace(2)* %91, !tbaa !0<br>
+ %93 = call float @llvm.SI.fs.interp(i32 0, i32 0, i32 %4, <2 x i32> %6)<br>
+ %94 = call float @llvm.SI.fs.interp(i32 1, i32 0, i32 %4, <2 x i32> %6)<br>
+ %95 = call float @llvm.SI.fs.interp(i32 0, i32 1, i32 %4, <2 x i32> %6)<br>
+ %96 = call float @llvm.SI.fs.interp(i32 1, i32 1, i32 %4, <2 x i32> %6)<br>
+ %97 = call float @llvm.SI.fs.interp(i32 2, i32 1, i32 %4, <2 x i32> %6)<br>
+ %98 = call float @llvm.SI.fs.interp(i32 0, i32 2, i32 %4, <2 x i32> %6)<br>
+ %99 = call float @llvm.SI.fs.interp(i32 1, i32 2, i32 %4, <2 x i32> %6)<br>
+ %100 = call float @llvm.SI.fs.interp(i32 2, i32 2, i32 %4, <2 x i32> %6)<br>
+ %101 = call float @llvm.SI.fs.interp(i32 0, i32 3, i32 %4, <2 x i32> %6)<br>
+ %102 = call float @llvm.SI.fs.interp(i32 1, i32 3, i32 %4, <2 x i32> %6)<br>
+ %103 = call float @llvm.SI.fs.interp(i32 2, i32 3, i32 %4, <2 x i32> %6)<br>
+ %104 = call float @llvm.SI.fs.interp(i32 0, i32 4, i32 %4, <2 x i32> %6)<br>
+ %105 = call float @llvm.SI.fs.interp(i32 1, i32 4, i32 %4, <2 x i32> %6)<br>
+ %106 = call float @llvm.SI.fs.interp(i32 2, i32 4, i32 %4, <2 x i32> %6)<br>
+ %107 = call float @llvm.SI.fs.interp(i32 0, i32 5, i32 %4, <2 x i32> %6)<br>
+ %108 = call float @llvm.SI.fs.interp(i32 1, i32 5, i32 %4, <2 x i32> %6)<br>
+ %109 = call float @llvm.SI.fs.interp(i32 2, i32 5, i32 %4, <2 x i32> %6)<br>
+ %110 = call i32 @llvm.SI.tid()<br>
+ %111 = getelementptr [64 x i32] addrspace(3)* @ddxy_lds, i32 0, i32 %110<br>
+ %112 = bitcast float %93 to i32<br>
+ store i32 %112, i32 addrspace(3)* %111<br>
+ %113 = bitcast float %94 to i32<br>
+ store i32 %113, i32 addrspace(3)* %111<br>
+ %114 = call i32 @llvm.SI.tid()<br>
+ %115 = getelementptr [64 x i32] addrspace(3)* @ddxy_lds, i32 0, i32 %114<br>
+ %116 = and i32 %114, -4<br>
+ %117 = getelementptr [64 x i32] addrspace(3)* @ddxy_lds, i32 0, i32 %116<br>
+ %118 = add i32 %116, 1<br>
+ %119 = getelementptr [64 x i32] addrspace(3)* @ddxy_lds, i32 0, i32 %118<br>
+ %120 = bitcast float %93 to i32<br>
+ store i32 %120, i32 addrspace(3)* %115<br>
+ %121 = load i32 addrspace(3)* %117<br>
+ %122 = bitcast i32 %121 to float<br>
+ %123 = load i32 addrspace(3)* %119<br>
+ %124 = bitcast i32 %123 to float<br>
+ %125 = fsub float %124, %122<br>
+ %126 = bitcast float %94 to i32<br>
+ store i32 %126, i32 addrspace(3)* %115<br>
+ %127 = load i32 addrspace(3)* %117<br>
+ %128 = bitcast i32 %127 to float<br>
+ %129 = load i32 addrspace(3)* %119<br>
+ %130 = bitcast i32 %129 to float<br>
+ %131 = fsub float %130, %128<br>
+ %132 = insertelement <4 x float> undef, float %125, i32 0<br>
+ %133 = insertelement <4 x float> %132, float %131, i32 1<br>
+ %134 = insertelement <4 x float> %133, float %131, i32 2<br>
+ %135 = insertelement <4 x float> %134, float %131, i32 3<br>
+ %136 = extractelement <4 x float> %135, i32 0<br>
+ %137 = extractelement <4 x float> %135, i32 1<br>
+ %138 = fmul float %60, %93<br>
+ %139 = fmul float %60, %94<br>
+ %140 = fmul float %60, %94<br>
+ %141 = fmul float %60, %94<br>
+ %142 = call i32 @llvm.SI.tid()<br>
+ %143 = getelementptr [64 x i32] addrspace(3)* @ddxy_lds, i32 0, i32 %142<br>
+ %144 = bitcast float %138 to i32<br>
+ store i32 %144, i32 addrspace(3)* %143<br>
+ %145 = bitcast float %139 to i32<br>
+ store i32 %145, i32 addrspace(3)* %143<br>
+ %146 = bitcast float %140 to i32<br>
+ store i32 %146, i32 addrspace(3)* %143<br>
+ %147 = bitcast float %141 to i32<br>
+ store i32 %147, i32 addrspace(3)* %143<br>
+ %148 = call i32 @llvm.SI.tid()<br>
+ %149 = getelementptr [64 x i32] addrspace(3)* @ddxy_lds, i32 0, i32 %148<br>
+ %150 = and i32 %148, -4<br>
+ %151 = getelementptr [64 x i32] addrspace(3)* @ddxy_lds, i32 0, i32 %150<br>
+ %152 = add i32 %150, 2<br>
+ %153 = getelementptr [64 x i32] addrspace(3)* @ddxy_lds, i32 0, i32 %152<br>
+ %154 = bitcast float %138 to i32<br>
+ store i32 %154, i32 addrspace(3)* %149<br>
+ %155 = load i32 addrspace(3)* %151<br>
+ %156 = bitcast i32 %155 to float<br>
+ %157 = load i32 addrspace(3)* %153<br>
+ %158 = bitcast i32 %157 to float<br>
+ %159 = fsub float %158, %156<br>
+ %160 = bitcast float %139 to i32<br>
+ store i32 %160, i32 addrspace(3)* %149<br>
+ %161 = load i32 addrspace(3)* %151<br>
+ %162 = bitcast i32 %161 to float<br>
+ %163 = load i32 addrspace(3)* %153<br>
+ %164 = bitcast i32 %163 to float<br>
+ %165 = fsub float %164, %162<br>
+ %166 = bitcast float %140 to i32<br>
+ store i32 %166, i32 addrspace(3)* %149<br>
+ %167 = load i32 addrspace(3)* %151<br>
+ %168 = bitcast i32 %167 to float<br>
+ %169 = load i32 addrspace(3)* %153<br>
+ %170 = bitcast i32 %169 to float<br>
+ %171 = fsub float %170, %168<br>
+ %172 = bitcast float %141 to i32<br>
+ store i32 %172, i32 addrspace(3)* %149<br>
+ %173 = load i32 addrspace(3)* %151<br>
+ %174 = bitcast i32 %173 to float<br>
+ %175 = load i32 addrspace(3)* %153<br>
+ %176 = bitcast i32 %175 to float<br>
+ %177 = fsub float %176, %174<br>
+ %178 = insertelement <4 x float> undef, float %159, i32 0<br>
+ %179 = insertelement <4 x float> %178, float %165, i32 1<br>
+ %180 = insertelement <4 x float> %179, float %171, i32 2<br>
+ %181 = insertelement <4 x float> %180, float %177, i32 3<br>
+ %182 = extractelement <4 x float> %181, i32 0<br>
+ %183 = extractelement <4 x float> %181, i32 1<br>
+ %184 = fdiv float 1.000000e+00, %97<br>
+ %185 = fmul float %33, %184<br>
+ %186 = fcmp uge float 1.000000e+00, %185<br>
+ %187 = select i1 %186, float %185, float 1.000000e+00<br>
+ %188 = fmul float %187, %30<br>
+ %189 = call float @ceil(float %188)<br>
+ %190 = fcmp uge float 3.000000e+00, %189<br>
+ %191 = select i1 %190, float 3.000000e+00, float %189<br>
+ %192 = fdiv float 1.000000e+00, %191<br>
+ %193 = fdiv float 1.000000e+00, %30<br>
+ %194 = fmul float %191, %193<br>
+ %195 = fmul float %31, %194<br>
+ %196 = fmul float %95, %95<br>
+ %197 = fmul float %96, %96<br>
+ %198 = fadd float %197, %196<br>
+ %199 = fmul float %97, %97<br>
+ %200 = fadd float %198, %199<br>
+ %201 = call float @llvm.AMDGPU.rsq(float %200)<br>
+ %202 = fmul float %95, %201<br>
+ %203 = fmul float %96, %201<br>
+ %204 = fmul float %202, %29<br>
+ %205 = fmul float %203, %29<br>
+ %206 = fmul float %204, -1.000000e+00<br>
+ %207 = fmul float %205, 1.000000e+00<br>
+ %208 = fmul float %206, %32<br>
+ %209 = fmul float %207, %32<br>
+ %210 = fsub float -0.000000e+00, %208<br>
+ %211 = fadd float %93, %210<br>
+ %212 = fsub float -0.000000e+00, %209<br>
+ %213 = fadd float %94, %212<br>
+ %214 = fmul float %206, %192<br>
+ %215 = fmul float %207, %192<br>
+ %216 = fmul float -1.000000e+00, %192<br>
+ %217 = bitcast float %136 to i32<br>
+ %218 = bitcast float %182 to i32<br>
+ %219 = bitcast float %137 to i32<br>
+ %220 = bitcast float %183 to i32<br>
+ %221 = insertelement <8 x i32> undef, i32 %217, i32 0<br>
+ %222 = insertelement <8 x i32> %221, i32 %218, i32 1<br>
+ %223 = insertelement <8 x i32> %222, i32 %219, i32 2<br>
+ %224 = insertelement <8 x i32> %223, i32 %220, i32 3<br>
+ br label %LOOP<br>
+<br>
+LOOP: ; preds = %ENDIF, %main_body<br>
+ %temp24.0 = phi float [ 1.000000e+00, %main_body ], [ %258, %ENDIF ]<br>
+ %temp28.0 = phi float [ %211, %main_body ], [ %253, %ENDIF ]<br>
+ %temp29.0 = phi float [ %213, %main_body ], [ %255, %ENDIF ]<br>
+ %temp30.0 = phi float [ 1.000000e+00, %main_body ], [ %257, %ENDIF ]<br>
+ %225 = fcmp oge float %temp24.0, %191<br>
+ %226 = sext i1 %225 to i32<br>
+ %227 = bitcast i32 %226 to float<br>
+ %228 = bitcast float %227 to i32<br>
+ %229 = icmp ne i32 %228, 0<br>
+ br i1 %229, label %IF, label %ENDIF<br>
+<br>
+IF: ; preds = %LOOP<br>
+ %230 = bitcast float %136 to i32<br>
+ %231 = bitcast float %182 to i32<br>
+ %232 = bitcast float %137 to i32<br>
+ %233 = bitcast float %183 to i32<br>
+ %234 = insertelement <8 x i32> undef, i32 %230, i32 0<br>
+ %235 = insertelement <8 x i32> %234, i32 %231, i32 1<br>
+ %236 = insertelement <8 x i32> %235, i32 %232, i32 2<br>
+ %237 = insertelement <8 x i32> %236, i32 %233, i32 3<br>
+ br label %LOOP65<br>
+<br>
+ENDIF: ; preds = %LOOP<br>
+ %238 = bitcast float %temp28.0 to i32<br>
+ %239 = bitcast float %temp29.0 to i32<br>
+ %240 = insertelement <8 x i32> %224, i32 %238, i32 4<br>
+ %241 = insertelement <8 x i32> %240, i32 %239, i32 5<br>
+ %242 = insertelement <8 x i32> %241, i32 undef, i32 6<br>
+ %243 = insertelement <8 x i32> %242, i32 undef, i32 7<br>
+ %244 = call <4 x float> @llvm.SI.sampled.v8i32(<8 x i32> %243, <32 x i8> %62, <16 x i8> %64, i32 2)<br>
+ %245 = extractelement <4 x float> %244, i32 3<br>
+ %246 = fcmp oge float %temp30.0, %245<br>
+ %247 = sext i1 %246 to i32<br>
+ %248 = bitcast i32 %247 to float<br>
+ %249 = bitcast float %248 to i32<br>
+ %250 = and i32 %249, 1065353216<br>
+ %251 = bitcast i32 %250 to float<br>
+ %252 = fmul float %214, %251<br>
+ %253 = fadd float %252, %temp28.0<br>
+ %254 = fmul float %215, %251<br>
+ %255 = fadd float %254, %temp29.0<br>
+ %256 = fmul float %216, %251<br>
+ %257 = fadd float %256, %temp30.0<br>
+ %258 = fadd float %temp24.0, 1.000000e+00<br>
+ br label %LOOP<br>
+<br>
+LOOP65: ; preds = %ENDIF66, %IF<br>
+ %temp24.1 = phi float [ 0.000000e+00, %IF ], [ %610, %ENDIF66 ]<br>
+ %temp28.1 = phi float [ %temp28.0, %IF ], [ %605, %ENDIF66 ]<br>
+ %temp29.1 = phi float [ %temp29.0, %IF ], [ %607, %ENDIF66 ]<br>
+ %temp30.1 = phi float [ %temp30.0, %IF ], [ %609, %ENDIF66 ]<br>
+ %temp32.0 = phi float [ 1.000000e+00, %IF ], [ %611, %ENDIF66 ]<br>
+ %259 = fcmp oge float %temp24.1, %195<br>
+ %260 = sext i1 %259 to i32<br>
+ %261 = bitcast i32 %260 to float<br>
+ %262 = bitcast float %261 to i32<br>
+ %263 = icmp ne i32 %262, 0<br>
+ br i1 %263, label %IF67, label %ENDIF66<br>
+<br>
+IF67: ; preds = %LOOP65<br>
+ %264 = bitcast float %136 to i32<br>
+ %265 = bitcast float %182 to i32<br>
+ %266 = bitcast float %137 to i32<br>
+ %267 = bitcast float %183 to i32<br>
+ %268 = bitcast float %temp28.1 to i32<br>
+ %269 = bitcast float %temp29.1 to i32<br>
+ %270 = insertelement <8 x i32> undef, i32 %264, i32 0<br>
+ %271 = insertelement <8 x i32> %270, i32 %265, i32 1<br>
+ %272 = insertelement <8 x i32> %271, i32 %266, i32 2<br>
+ %273 = insertelement <8 x i32> %272, i32 %267, i32 3<br>
+ %274 = insertelement <8 x i32> %273, i32 %268, i32 4<br>
+ %275 = insertelement <8 x i32> %274, i32 %269, i32 5<br>
+ %276 = insertelement <8 x i32> %275, i32 undef, i32 6<br>
+ %277 = insertelement <8 x i32> %276, i32 undef, i32 7<br>
+ %278 = call <4 x float> @llvm.SI.sampled.v8i32(<8 x i32> %277, <32 x i8> %66, <16 x i8> %68, i32 2)<br>
+ %279 = extractelement <4 x float> %278, i32 0<br>
+ %280 = extractelement <4 x float> %278, i32 1<br>
+ %281 = extractelement <4 x float> %278, i32 2<br>
+ %282 = extractelement <4 x float> %278, i32 3<br>
+ %283 = fmul float %282, %47<br>
+ %284 = bitcast float %136 to i32<br>
+ %285 = bitcast float %182 to i32<br>
+ %286 = bitcast float %137 to i32<br>
+ %287 = bitcast float %183 to i32<br>
+ %288 = bitcast float %temp28.1 to i32<br>
+ %289 = bitcast float %temp29.1 to i32<br>
+ %290 = insertelement <8 x i32> undef, i32 %284, i32 0<br>
+ %291 = insertelement <8 x i32> %290, i32 %285, i32 1<br>
+ %292 = insertelement <8 x i32> %291, i32 %286, i32 2<br>
+ %293 = insertelement <8 x i32> %292, i32 %287, i32 3<br>
+ %294 = insertelement <8 x i32> %293, i32 %288, i32 4<br>
+ %295 = insertelement <8 x i32> %294, i32 %289, i32 5<br>
+ %296 = insertelement <8 x i32> %295, i32 undef, i32 6<br>
+ %297 = insertelement <8 x i32> %296, i32 undef, i32 7<br>
+ %298 = call <4 x float> @llvm.SI.sampled.v8i32(<8 x i32> %297, <32 x i8> %82, <16 x i8> %84, i32 2)<br>
+ %299 = extractelement <4 x float> %298, i32 0<br>
+ %300 = extractelement <4 x float> %298, i32 1<br>
+ %301 = extractelement <4 x float> %298, i32 2<br>
+ %302 = bitcast float %136 to i32<br>
+ %303 = bitcast float %182 to i32<br>
+ %304 = bitcast float %137 to i32<br>
+ %305 = bitcast float %183 to i32<br>
+ %306 = bitcast float %temp28.1 to i32<br>
+ %307 = bitcast float %temp29.1 to i32<br>
+ %308 = insertelement <8 x i32> undef, i32 %302, i32 0<br>
+ %309 = insertelement <8 x i32> %308, i32 %303, i32 1<br>
+ %310 = insertelement <8 x i32> %309, i32 %304, i32 2<br>
+ %311 = insertelement <8 x i32> %310, i32 %305, i32 3<br>
+ %312 = insertelement <8 x i32> %311, i32 %306, i32 4<br>
+ %313 = insertelement <8 x i32> %312, i32 %307, i32 5<br>
+ %314 = insertelement <8 x i32> %313, i32 undef, i32 6<br>
+ %315 = insertelement <8 x i32> %314, i32 undef, i32 7<br>
+ %316 = call <4 x float> @llvm.SI.sampled.v8i32(<8 x i32> %315, <32 x i8> %78, <16 x i8> %80, i32 2)<br>
+ %317 = extractelement <4 x float> %316, i32 0<br>
+ %318 = extractelement <4 x float> %316, i32 1<br>
+ %319 = extractelement <4 x float> %316, i32 2<br>
+ %320 = fmul float %317, %23<br>
+ %321 = fmul float %318, %24<br>
+ %322 = fmul float %319, %25<br>
+ %323 = fmul float %299, %26<br>
+ %324 = fadd float %323, %320<br>
+ %325 = fmul float %300, %27<br>
+ %326 = fadd float %325, %321<br>
+ %327 = fmul float %301, %28<br>
+ %328 = fadd float %327, %322<br>
+ %329 = fadd float %279, %324<br>
+ %330 = fadd float %280, %326<br>
+ %331 = fadd float %281, %328<br>
+ %332 = bitcast float %136 to i32<br>
+ %333 = bitcast float %182 to i32<br>
+ %334 = bitcast float %137 to i32<br>
+ %335 = bitcast float %183 to i32<br>
+ %336 = bitcast float %temp28.1 to i32<br>
+ %337 = bitcast float %temp29.1 to i32<br>
+ %338 = insertelement <8 x i32> undef, i32 %332, i32 0<br>
+ %339 = insertelement <8 x i32> %338, i32 %333, i32 1<br>
+ %340 = insertelement <8 x i32> %339, i32 %334, i32 2<br>
+ %341 = insertelement <8 x i32> %340, i32 %335, i32 3<br>
+ %342 = insertelement <8 x i32> %341, i32 %336, i32 4<br>
+ %343 = insertelement <8 x i32> %342, i32 %337, i32 5<br>
+ %344 = insertelement <8 x i32> %343, i32 undef, i32 6<br>
+ %345 = insertelement <8 x i32> %344, i32 undef, i32 7<br>
+ %346 = call <4 x float> @llvm.SI.sampled.v8i32(<8 x i32> %345, <32 x i8> %62, <16 x i8> %64, i32 2)<br>
+ %347 = extractelement <4 x float> %346, i32 0<br>
+ %348 = extractelement <4 x float> %346, i32 1<br>
+ %349 = extractelement <4 x float> %346, i32 2<br>
+ %350 = fadd float %347, -5.000000e-01<br>
+ %351 = fadd float %348, -5.000000e-01<br>
+ %352 = fadd float %349, -5.000000e-01<br>
+ %353 = fmul float %350, %350<br>
+ %354 = fmul float %351, %351<br>
+ %355 = fadd float %354, %353<br>
+ %356 = fmul float %352, %352<br>
+ %357 = fadd float %355, %356<br>
+ %358 = call float @llvm.AMDGPU.rsq(float %357)<br>
+ %359 = fmul float %350, %358<br>
+ %360 = fmul float %351, %358<br>
+ %361 = fmul float %352, %358<br>
+ %362 = bitcast float %136 to i32<br>
+ %363 = bitcast float %182 to i32<br>
+ %364 = bitcast float %137 to i32<br>
+ %365 = bitcast float %183 to i32<br>
+ %366 = bitcast float %temp28.1 to i32<br>
+ %367 = bitcast float %temp29.1 to i32<br>
+ %368 = insertelement <8 x i32> undef, i32 %362, i32 0<br>
+ %369 = insertelement <8 x i32> %368, i32 %363, i32 1<br>
+ %370 = insertelement <8 x i32> %369, i32 %364, i32 2<br>
+ %371 = insertelement <8 x i32> %370, i32 %365, i32 3<br>
+ %372 = insertelement <8 x i32> %371, i32 %366, i32 4<br>
+ %373 = insertelement <8 x i32> %372, i32 %367, i32 5<br>
+ %374 = insertelement <8 x i32> %373, i32 undef, i32 6<br>
+ %375 = insertelement <8 x i32> %374, i32 undef, i32 7<br>
+ %376 = call <4 x float> @llvm.SI.sampled.v8i32(<8 x i32> %375, <32 x i8> %70, <16 x i8> %72, i32 2)<br>
+ %377 = extractelement <4 x float> %376, i32 0<br>
+ %378 = extractelement <4 x float> %376, i32 1<br>
+ %379 = extractelement <4 x float> %376, i32 2<br>
+ %380 = extractelement <4 x float> %376, i32 3<br>
+ %381 = fsub float -0.000000e+00, %95<br>
+ %382 = fsub float -0.000000e+00, %96<br>
+ %383 = fsub float -0.000000e+00, %97<br>
+ %384 = fmul float %359, %381<br>
+ %385 = fmul float %360, %382<br>
+ %386 = fadd float %385, %384<br>
+ %387 = fmul float %361, %383<br>
+ %388 = fadd float %386, %387<br>
+ %389 = fmul float %388, %359<br>
+ %390 = fmul float %388, %360<br>
+ %391 = fmul float %388, %361<br>
+ %392 = fmul float 2.000000e+00, %389<br>
+ %393 = fmul float 2.000000e+00, %390<br>
+ %394 = fmul float 2.000000e+00, %391<br>
+ %395 = fsub float -0.000000e+00, %392<br>
+ %396 = fadd float %381, %395<br>
+ %397 = fsub float -0.000000e+00, %393<br>
+ %398 = fadd float %382, %397<br>
+ %399 = fsub float -0.000000e+00, %394<br>
+ %400 = fadd float %383, %399<br>
+ %401 = fmul float %396, %98<br>
+ %402 = fmul float %396, %99<br>
+ %403 = fmul float %396, %100<br>
+ %404 = fmul float %398, %101<br>
+ %405 = fadd float %404, %401<br>
+ %406 = fmul float %398, %102<br>
+ %407 = fadd float %406, %402<br>
+ %408 = fmul float %398, %103<br>
+ %409 = fadd float %408, %403<br>
+ %410 = fmul float %400, %104<br>
+ %411 = fadd float %410, %405<br>
+ %412 = fmul float %400, %105<br>
+ %413 = fadd float %412, %407<br>
+ %414 = fmul float %400, %106<br>
+ %415 = fadd float %414, %409<br>
+ %416 = bitcast float %136 to i32<br>
+ %417 = bitcast float %182 to i32<br>
+ %418 = bitcast float %137 to i32<br>
+ %419 = bitcast float %183 to i32<br>
+ %420 = bitcast float %temp28.1 to i32<br>
+ %421 = bitcast float %temp29.1 to i32<br>
+ %422 = insertelement <8 x i32> undef, i32 %416, i32 0<br>
+ %423 = insertelement <8 x i32> %422, i32 %417, i32 1<br>
+ %424 = insertelement <8 x i32> %423, i32 %418, i32 2<br>
+ %425 = insertelement <8 x i32> %424, i32 %419, i32 3<br>
+ %426 = insertelement <8 x i32> %425, i32 %420, i32 4<br>
+ %427 = insertelement <8 x i32> %426, i32 %421, i32 5<br>
+ %428 = insertelement <8 x i32> %427, i32 undef, i32 6<br>
+ %429 = insertelement <8 x i32> %428, i32 undef, i32 7<br>
+ %430 = call <4 x float> @llvm.SI.sampled.v8i32(<8 x i32> %429, <32 x i8> %86, <16 x i8> %88, i32 2)<br>
+ %431 = extractelement <4 x float> %430, i32 0<br>
+ %432 = extractelement <4 x float> %430, i32 1<br>
+ %433 = extractelement <4 x float> %430, i32 2<br>
+ %434 = fmul float %48, %411<br>
+ %435 = fmul float %49, %411<br>
+ %436 = fmul float %50, %411<br>
+ %437 = fmul float %51, %413<br>
+ %438 = fadd float %437, %434<br>
+ %439 = fmul float %52, %413<br>
+ %440 = fadd float %439, %435<br>
+ %441 = fmul float %53, %413<br>
+ %442 = fadd float %441, %436<br>
+ %443 = fmul float %54, %415<br>
+ %444 = fadd float %443, %438<br>
+ %445 = fmul float %55, %415<br>
+ %446 = fadd float %445, %440<br>
+ %447 = fmul float %56, %415<br>
+ %448 = fadd float %447, %442<br>
+ %449 = insertelement <4 x float> undef, float %444, i32 0<br>
+ %450 = insertelement <4 x float> %449, float %446, i32 1<br>
+ %451 = insertelement <4 x float> %450, float %448, i32 2<br>
+ %452 = insertelement <4 x float> %451, float %195, i32 3<br>
+ %453 = call <4 x float> @llvm.AMDGPU.cube(<4 x float> %452)<br>
+ %454 = extractelement <4 x float> %453, i32 0<br>
+ %455 = extractelement <4 x float> %453, i32 1<br>
+ %456 = extractelement <4 x float> %453, i32 2<br>
+ %457 = extractelement <4 x float> %453, i32 3<br>
+ %458 = call float @fabs(float %456)<br>
+ %459 = fdiv float 1.000000e+00, %458<br>
+ %460 = fmul float %454, %459<br>
+ %461 = fadd float %460, 1.500000e+00<br>
+ %462 = fmul float %455, %459<br>
+ %463 = fadd float %462, 1.500000e+00<br>
+ %464 = bitcast float %463 to i32<br>
+ %465 = bitcast float %461 to i32<br>
+ %466 = bitcast float %457 to i32<br>
+ %467 = insertelement <4 x i32> undef, i32 %464, i32 0<br>
+ %468 = insertelement <4 x i32> %467, i32 %465, i32 1<br>
+ %469 = insertelement <4 x i32> %468, i32 %466, i32 2<br>
+ %470 = insertelement <4 x i32> %469, i32 undef, i32 3<br>
+ %471 = call <4 x float> @llvm.SI.sample.v4i32(<4 x i32> %470, <32 x i8> %90, <16 x i8> %92, i32 4)<br>
+ %472 = extractelement <4 x float> %471, i32 0<br>
+ %473 = extractelement <4 x float> %471, i32 1<br>
+ %474 = extractelement <4 x float> %471, i32 2<br>
+ %475 = fmul float %431, %472<br>
+ %476 = fadd float %475, %329<br>
+ %477 = fmul float %432, %473<br>
+ %478 = fadd float %477, %330<br>
+ %479 = fmul float %433, %474<br>
+ %480 = fadd float %479, %331<br>
+ %481 = fmul float %107, %107<br>
+ %482 = fmul float %108, %108<br>
+ %483 = fadd float %482, %481<br>
+ %484 = fmul float %109, %109<br>
+ %485 = fadd float %483, %484<br>
+ %486 = call float @llvm.AMDGPU.rsq(float %485)<br>
+ %487 = fmul float %107, %486<br>
+ %488 = fmul float %108, %486<br>
+ %489 = fmul float %109, %486<br>
+ %490 = fmul float %377, %40<br>
+ %491 = fmul float %378, %41<br>
+ %492 = fmul float %379, %42<br>
+ %493 = fmul float %359, %487<br>
+ %494 = fmul float %360, %488<br>
+ %495 = fadd float %494, %493<br>
+ %496 = fmul float %361, %489<br>
+ %497 = fadd float %495, %496<br>
+ %498 = fmul float %497, %359<br>
+ %499 = fmul float %497, %360<br>
+ %500 = fmul float %497, %361<br>
+ %501 = fmul float 2.000000e+00, %498<br>
+ %502 = fmul float 2.000000e+00, %499<br>
+ %503 = fmul float 2.000000e+00, %500<br>
+ %504 = fsub float -0.000000e+00, %501<br>
+ %505 = fadd float %487, %504<br>
+ %506 = fsub float -0.000000e+00, %502<br>
+ %507 = fadd float %488, %506<br>
+ %508 = fsub float -0.000000e+00, %503<br>
+ %509 = fadd float %489, %508<br>
+ %510 = fmul float %95, %95<br>
+ %511 = fmul float %96, %96<br>
+ %512 = fadd float %511, %510<br>
+ %513 = fmul float %97, %97<br>
+ %514 = fadd float %512, %513<br>
+ %515 = call float @llvm.AMDGPU.rsq(float %514)<br>
+ %516 = fmul float %95, %515<br>
+ %517 = fmul float %96, %515<br>
+ %518 = fmul float %97, %515<br>
+ %519 = fmul float %505, %516<br>
+ %520 = fmul float %507, %517<br>
+ %521 = fadd float %520, %519<br>
+ %522 = fmul float %509, %518<br>
+ %523 = fadd float %521, %522<br>
+ %524 = fsub float -0.000000e+00, %523<br>
+ %525 = fcmp uge float %524, 0.000000e+00<br>
+ %526 = select i1 %525, float %524, float 0.000000e+00<br>
+ %527 = fmul float %43, %380<br>
+ %528 = fadd float %527, 1.000000e+00<br>
+ %529 = call float @llvm.pow.f32(float %526, float %528)<br>
+ %530 = fmul float %476, %37<br>
+ %531 = fmul float %478, %38<br>
+ %532 = fmul float %480, %39<br>
+ %533 = fmul float %359, %487<br>
+ %534 = fmul float %360, %488<br>
+ %535 = fadd float %534, %533<br>
+ %536 = fmul float %361, %489<br>
+ %537 = fadd float %535, %536<br>
+ %538 = fcmp uge float %537, 0.000000e+00<br>
+ %539 = select i1 %538, float %537, float 0.000000e+00<br>
+ %540 = fmul float %530, %539<br>
+ %541 = fmul float %531, %539<br>
+ %542 = fmul float %532, %539<br>
+ %543 = fmul float %490, %529<br>
+ %544 = fadd float %543, %540<br>
+ %545 = fmul float %491, %529<br>
+ %546 = fadd float %545, %541<br>
+ %547 = fmul float %492, %529<br>
+ %548 = fadd float %547, %542<br>
+ %549 = fmul float %476, %34<br>
+ %550 = fmul float %478, %35<br>
+ %551 = fmul float %480, %36<br>
+ %552 = fmul float %544, %57<br>
+ %553 = fadd float %552, %549<br>
+ %554 = fmul float %546, %58<br>
+ %555 = fadd float %554, %550<br>
+ %556 = fmul float %548, %59<br>
+ %557 = fadd float %556, %551<br>
+ %558 = bitcast float %136 to i32<br>
+ %559 = bitcast float %182 to i32<br>
+ %560 = bitcast float %137 to i32<br>
+ %561 = bitcast float %183 to i32<br>
+ %562 = bitcast float %temp28.1 to i32<br>
+ %563 = bitcast float %temp29.1 to i32<br>
+ %564 = insertelement <8 x i32> undef, i32 %558, i32 0<br>
+ %565 = insertelement <8 x i32> %564, i32 %559, i32 1<br>
+ %566 = insertelement <8 x i32> %565, i32 %560, i32 2<br>
+ %567 = insertelement <8 x i32> %566, i32 %561, i32 3<br>
+ %568 = insertelement <8 x i32> %567, i32 %562, i32 4<br>
+ %569 = insertelement <8 x i32> %568, i32 %563, i32 5<br>
+ %570 = insertelement <8 x i32> %569, i32 undef, i32 6<br>
+ %571 = insertelement <8 x i32> %570, i32 undef, i32 7<br>
+ %572 = call <4 x float> @llvm.SI.sampled.v8i32(<8 x i32> %571, <32 x i8> %74, <16 x i8> %76, i32 2)<br>
+ %573 = extractelement <4 x float> %572, i32 0<br>
+ %574 = extractelement <4 x float> %572, i32 1<br>
+ %575 = extractelement <4 x float> %572, i32 2<br>
+ %576 = fmul float %573, %44<br>
+ %577 = fadd float %576, %553<br>
+ %578 = fmul float %574, %45<br>
+ %579 = fadd float %578, %555<br>
+ %580 = fmul float %575, %46<br>
+ %581 = fadd float %580, %557<br>
+ %582 = call i32 @llvm.SI.packf16(float %577, float %579)<br>
+ %583 = bitcast i32 %582 to float<br>
+ %584 = call i32 @llvm.SI.packf16(float %581, float %283)<br>
+ %585 = bitcast i32 %584 to float<br>
+ call void @llvm.SI.export(i32 15, i32 1, i32 1, i32 0, i32 1, float %583, float %585, float %583, float %585)<br>
+ ret void<br>
+<br>
+ENDIF66: ; preds = %LOOP65<br>
+ %586 = bitcast float %temp28.1 to i32<br>
+ %587 = bitcast float %temp29.1 to i32<br>
+ %588 = insertelement <8 x i32> %237, i32 %586, i32 4<br>
+ %589 = insertelement <8 x i32> %588, i32 %587, i32 5<br>
+ %590 = insertelement <8 x i32> %589, i32 undef, i32 6<br>
+ %591 = insertelement <8 x i32> %590, i32 undef, i32 7<br>
+ %592 = call <4 x float> @llvm.SI.sampled.v8i32(<8 x i32> %591, <32 x i8> %62, <16 x i8> %64, i32 2)<br>
+ %593 = extractelement <4 x float> %592, i32 3<br>
+ %594 = fcmp oge float %temp30.1, %593<br>
+ %595 = sext i1 %594 to i32<br>
+ %596 = bitcast i32 %595 to float<br>
+ %597 = bitcast float %596 to i32<br>
+ %598 = and i32 %597, 1065353216<br>
+ %599 = bitcast i32 %598 to float<br>
+ %600 = fmul float 5.000000e-01, %temp32.0<br>
+ %601 = fsub float -0.000000e+00, %600<br>
+ %602 = fmul float %599, %temp32.0<br>
+ %603 = fadd float %602, %601<br>
+ %604 = fmul float %214, %603<br>
+ %605 = fadd float %604, %temp28.1<br>
+ %606 = fmul float %215, %603<br>
+ %607 = fadd float %606, %temp29.1<br>
+ %608 = fmul float %216, %603<br>
+ %609 = fadd float %608, %temp30.1<br>
+ %610 = fadd float %temp24.1, 1.000000e+00<br>
+ %611 = fmul float %temp32.0, 5.000000e-01<br>
+ br label %LOOP65<br>
+}<br>
+<br>
+; Function Attrs: nounwind readnone<br>
+declare float @llvm.SI.load.const(<16 x i8>, i32) #1<br>
+<br>
+; Function Attrs: nounwind readnone<br>
+declare float @llvm.SI.fs.interp(i32, i32, i32, <2 x i32>) #1<br>
+<br>
+; Function Attrs: readnone<br>
+declare i32 @llvm.SI.tid() #2<br>
+<br>
+; Function Attrs: readonly<br>
+declare float @ceil(float) #3<br>
+<br>
+; Function Attrs: readnone<br>
+declare float @llvm.AMDGPU.rsq(float) #2<br>
+<br>
+; Function Attrs: nounwind readnone<br>
+declare <4 x float> @llvm.SI.sampled.v8i32(<8 x i32>, <32 x i8>, <16 x i8>, i32) #1<br>
+<br>
+; Function Attrs: readnone<br>
+declare <4 x float> @llvm.AMDGPU.cube(<4 x float>) #2<br>
+<br>
+; Function Attrs: readnone<br>
+declare float @fabs(float) #2<br>
+<br>
+; Function Attrs: nounwind readnone<br>
+declare <4 x float> @llvm.SI.sample.v4i32(<4 x i32>, <32 x i8>, <16 x i8>, i32) #1<br>
+<br>
+; Function Attrs: nounwind readonly<br>
+declare float @llvm.pow.f32(float, float) #4<br>
+<br>
+; Function Attrs: nounwind readnone<br>
+declare i32 @llvm.SI.packf16(float, float) #1<br>
+<br>
+declare void @llvm.SI.export(i32, i32, i32, i32, i32, float, float, float, float)<br>
+<br>
+attributes #0 = { "ShaderType"="0" }<br>
+attributes #1 = { nounwind readnone }<br>
+attributes #2 = { readnone }<br>
+attributes #3 = { readonly }<br>
+attributes #4 = { nounwind readonly }<br>
+<br>
+!0 = metadata !{metadata !"const", null, i32 1}<br>
<br>
<br>
_______________________________________________<br>
llvm-commits mailing list<br>
<a href="mailto:llvm-commits@cs.uiuc.edu">llvm-commits@cs.uiuc.edu</a><br>
<a href="http://lists.cs.uiuc.edu/mailman/listinfo/llvm-commits" target="_blank">http://lists.cs.uiuc.edu/mailman/listinfo/llvm-commits</a><br>
</blockquote></div><br></div>